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Virtex-5 FPGA 系列
 

Virtex-5 TXT FPGA 针对高带宽应用（如有线通信与数据通信系统内的桥接、开关和集聚）进行了优化，是世界上首款采用 1.0V 三栅极氧化层工艺技术制造而成的 65nm 系列的引脚兼容成员。

Virtex-5 TXT FPGA 的优势
最高的带宽为 100G 系统实现了单 FPGA 桥接
  • GTX 6.5Gbps 收发器多达48个
  • 独立固定输入和输出通路实现了 600+Gpbs 的串行 I/O 带宽
  • SelectIO™ 技术在外部高速存储器内实现了数据缓冲
全面的解决方案加快了新产品的面市步伐
  • 特性齐全的 GTX 收发器
    • 集成式“变速箱”实现了灵活编码：8b/10b、64b/66b、64b/67b
    • DFE 接收均衡，可以实现最佳的信号完整性
    • 最低功耗：6.5 Gbps 下，低于 200mW/通道
  • 灵活的逻辑架构使得设计者能够对不断变化的接口标准作出回应，甚至是在部署完毕之后
  • Xilinx 和第三方专家提供了针对主要协议的软 IP
    • Sarance Technologies 的 100G 以太网、120G/50G Interlaken
    • Avalon Systems 的 SFI-5、OC-768、OTU3、EFEC、GFEC
    • MorethanIP 的 RXAUI、10G 以太网、2.5G 以太网、以太网开关 IP
    • Xilinx 的 PCI Express® Gen2、10G 以太网、XAUI
  • 设计工具
    • Xilinx 的 ISE® 设计工具套件、用于实现设计优化的 PlanAhead™ 工具和 ChipScope™ Pro 串行 I/O 工具套件
    • Synopsys HSPICE 模型、Mentor ELDO、Ansoft Nexxim、Agilent ADS 和 Mentor SI 工具
  • 技术支持
    • Xilinx 设计服务（XDS）：“快速启动 - TXT 计划”
    • I/O 专家和 RocketLabs 评估资源
Virtex-5 TXT FPGA 的特性
特性 LX LXT SXT FXT TXT
带有 6-输入 LUT 的 ExpressFabric™ 架构
550 MHz 时钟控制与管理文件（2DCM + 1PLL） 2 - 6 1-6 2 - 6 2 - 6 6
550MHz block RAM（1,000Kb） 1.2 - 10.4 .94 - 11.7 3 - 18.6 2.4 - 6.4 8.2 - 11.7
3.2 Gbps SelectIO™ 技术
RocketIO GTP 收发器 -- 4-24 8-24 -- --
6.5Gbps GTX 收发器 -- -- -- 8-24 40 - 48
PCI Express® 端点模块 -- 1 1 1-4 1
以太网媒体访问控制器 -- 2 - 4 4 4-8 4
550 Mhz DSP48E slice 32 - 192 24-192 192-1,056 64-320 80 - 96
PowerPC 440 处理器模块 -- -- -- 1 - 2 --
系统监控器和模数转换器
Sparse chevron 封装技术
增强型配置和比特流保护
突出显示行表示主要特性。

 
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